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《数字电路复习题


复习题

一、 填空题(共分) 1. ?10111101.11?2 ? ? 2. ? 7A.C1?16 ? ?

?8 ? ?

?16 ? ?

?10 //;

?2 ? ?

?8 ? ?

?10

3.四位二进制

编码器有_16___个输入端;_4___个输出端。 4.除去高、低电平两种输出状态外,三态门的第三态输出称为___ _____状态。 5.组合逻辑电路不存在输出到输入的________通路,因此其 输出状态不影响输入状态。 6.对于上升沿触发的 D 触发器,它的次态仅取决于 CP______沿 到达时________的状态。 7.下图所示电路中,Y1 =__________;Y2 =______
VCC Y2 A B A B B A Y3

A B

Y1

______;Y3 =____________。

8.根据触发器功能的不同,可将触发器分成四种,分别是____触 发器、____触发器、____触发器和____触发器。 9.将十进制数 287 转换成二进制数是________;十六进制数 是_______。

Y2 A B C Y1 A B A 1 B

Y3

10.

下图所示电路中, Y1 =______; Y2 =______; Y3 =

______。

11.

将 BCD 码翻译成十个对应输出信号的电路称为_______

_,它有___个输入端,____输出端。 12. 13. 14.
__________ _。 逻辑变量的异或表达式为: A ? B ? __________

二进制数 A=1011010;B=10111,则 A-B=_______。 组合逻辑电路没有__记忆____功能, 因此, 它是由___

_门__组成。 15. 同步 RS 触发器的特性方程为: Q =______,其约束方程为:
n+1

______。 16. 将若干片中规模集成电路计数器串联后, 总的计数容量为每片计 。

数容量的_乘积___ 17.

若用触发器组成某十一进制加法计数器,需要____个触发

器,有__个无效状态。 18. 叙述 FPGA 设计流程,以及涉及的 EDA 工具及其在整个流程中的作用

1.设计输入(原理图/HDL 文本编辑);2.综合;3.适配;4.仿真;5.编 程下载;6.硬件测试 二、选择题(共 15 分) 1. 下列函数中,是最小项表达式形式的是_________ A. C. Y=A+BC Y= ABC ? ABC B. Y2 =ABC+ACD D. Y= ABC ? ABC

2. 对于四位二进制译码器,其相应的输出端共有________ A. 4个 B. 16 个 C. 8 个 D. 10 个

3. 用 8421 码表示的十进制数 45,可以写成__________ A. 45 D. [101101]2 4. 属于组合逻辑电路的是___________ A. 触发器 B. 全加器 C. 移位寄存器 D. 计数器 B. [101101]BCD C. [01000101]BCD

5. 某计数器的状态转换图如下,其计数的容量为______ A. 八 B. 五 C. 四
111 000

D. 三
001 010

110 101

100

011

6. 采用 OC 门主要解决了_____

A.TTL 与非门不能相与的问题

B. TTL 与非门不能线

与的问题 C. TTL 与非门不能相或的问题
7.

采用 OC 门主要解决了_____ A.TTL 与非门不能相与的问题 与的问题 C. TTL 与非门不能相或的问题 B. TTL 与非门不能线

8. 已知某触发的特性表如下(A、B 为触发器的输入)其输出信号的逻辑表达式为___

A. Qn+1 =A
A 0 0 1 1 B 0 1 0 1 Q
n+1 n

B.
说明 保持 置0 置1 翻转

Qn ?1 ? AQn ? AQn

C.

Qn ?1 ? AQn ? BQn

Q

0 1 Q
n

9. 用卡诺图化简逻辑函数时,若每个方格群尽可能选大,则在化简后的最简表达式中 A.与项的个数少 B. 每个与项中含有的变量个数少 。 Y 0 1 1 1 A. Y ? C C. Y ? AB ? C B. Y ? ABC D. Y ? BC ? C C. 化简结果具有唯一

10. 已知某电路的真值表如下,该电路的逻辑表达式为 A 0 0 0 0 B 0 0 1 1 C 0 1 0 1 Y 0 1 0 1 A 1 1 1 1 B 0 0 1 1 C 0 1 0 1

11. 要实现 Q n ?1 ? Q n ,JK 触发器的 J、K 取值应为_____。 A. J=0,K=0 B. J=0,K=1 C. J=1,K=0 D. J=1,K=1

数值[375]10 与下列哪个数相等___。 A. [111011101]2 B. [567]8 C. [11101110]BCD D. [1F5]16

12. 属于组合逻辑电路的是___________ A. 触发器 B. 全加器 C. 移位寄存器 D. 计数器

13. M 进制计数器状态转换的特点是:设定初态后,每来___个计数脉冲 CP,计数器重新回到初态。 A. M-1 B. M+1 C. M )电平信号。

? 、 SD ? 端加( 14. 预将触发器置为“0”态,应在触发器的 RD
? ? 1, S D ? ?1 (A) RD

? ? 1, (B) RD ? ?0 (D) RD
)的计数器。

? ?0 SD

? ? 0, (C) RD

? ?1 SD

? ?0 SD

15. 同步计数器是指(

(A)由同类型的触发器构成 (C)可用前级的输出做后级触发器的时钟 16. 下列几种说法中与 BCD 码的性质不符的是(

(B)各触发器时钟端连在一起,统一由系统时钟控制 (D)可用后级的输出做前级触发器的时钟 )。

(A)一组四位二进制数组成的码只能表示一位十进制数 (B)BCD 码是一种人为选定的 0 ~ 9 十个数字的代码 (C)BCD 码是一组四位二进制数,能表示十六以内的任何一个十进制数 (D)BCD 码有多种 17. 下列电路中,不属于组合逻辑电路的是 (1)译码器 (2)全加器 (3)寄存器 (4)编码器 时,处于允许状态。 (4)010

18. 译码器 74LS138 的使能端 S1 S 2 S 3 取值为 (1)011 (2)100 (3)101

简答题和分析设计题(65 分) 第一章 1、数制间转换:P7,例题 1-1、例题 1-2、例题 1-3、 例题 1-4、例题 1-5、例题 1-6 2、BCD 码:例题:P11,例题 1-10 3、补码运算:P15,例题 1-18(3)

第二章

第三章 1、标准与或表达式:P55,例题 3-9、3-10 2、逻辑代数化简:P57,例题 3-14 到 3-25 3、卡诺图化简:P60,例题 3-31、3-32

第四章 1、组合逻辑电路分析: P68,例题 4-2 2、组合逻辑电路设计:P70,例题 4-3 3、编码器 4、用通用译码器实现逻辑函数:P79,例题 4-5 5、用数据选择器实现逻辑函数:P85,例题 4-8 6、加法器:P87,P88,真值表,电路图

第五章 第六章

第七章 1、同步时序电路分析:P178,例题 7-1 2、同步时序电路设计:P185,例题 7-4 3、设计可控计数器:P214,习题 7-18


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